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1桁の2進数A,Bを加算し、Xに桁上がり、Yに桁上げなしの和(和の1桁目)が得られる論理回路はどれか。
結論 → 詳細 → 補足 の 3 層構成
エが正解となるのは、2つの1桁の2進数AとBを加算した結果、桁上がり（キャリーアウト）がXに、桁上げなしの和（サマ）がYにそれぞれ出力される回路が、まさに全加算器（Full Adder）の基本的な構成だからです。全加算器は、2つの入力ビットと、前の桁からの桁上がり（キャリーイン）を考慮して、和と桁上がり（キャリーアウト）を出力する論理回路です。この問題では、前の桁からの桁上がり（キャリーイン）を考慮しない、つまり0とみなした場合の、2つの入力ビットのみによる加算器を想定しており、これは半加算器（Half Adder）に相当します。半加算器は、2つの入力ビットA, Bを受け取り、和（S）と桁上がり（C）を出力します。和SはA XOR B、桁上がりCはA AND Bで計算されます。
アは、AとBの論理積（AND）をXに、AとBの論理和（OR）をYに出力しているため、加算結果とは異なります。イは、AとBの排他的論理和（XOR）をXに、AとBの論理和（OR）をYに出力しており、これは問題の要求とは逆の出力をしています。ウは、AとBの論理和（OR）をXに、AとBの排他的論理和（XOR）をYに出力しており、これも加算結果の対応が逆になっています。
解説は Google Gemini に IPA 公式の問題文・公式解答を入力して生成しています。 事実誤認・選択肢の取り違え・最新法令の反映漏れ等を含む可能性があるため、 重要な判断は必ず IPA 公式資料でご確認ください。
最終更新:
検証プロセス・誤り報告フローは 運営透明性レポートで公開しています。
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