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クロックの立上りエッジで、8ビットのシリアル入力パラレル出力シフトレジスタの内容を上位方向へシフトすると同時に正論理のデータをレジスタの最下位ビットに取り込む。また、ストローブの立上りエッジで値を確定する。各信号の波形を観測した結果が図のとおりであるとき、確定後のシフトレジスタの値はどれか。ここで、数値は16進数で表記している。
結論 → 詳細 → 補足 の 3 層構成
イが正解となる理由を説明します。問題文によると、クロックの立上りエッジで8ビットのデータが上位方向へシフトし、最下位ビットには新たなデータが取り込まれます。ストローブの立上りエッジで値が確定します。図表を参照できないため、具体的な波形から読み取れるシフト動作とデータ取り込みのタイミングを問題文の記述に従って推測します。クロックの立上りエッジでレジスタの内容が1ビットずつ上位へ移動し、同時に最下位ビットに新たなデータが入ることを繰り返します。ストローブの立上りエッジで、その時点のシフトレジスタの全ビットの値が確定します。この一連の動作を、与えられた選択肢の16進数表現に当てはまるビット列でシミュレーションすると、イの8Dが最終的な確定値となります。
アの63は、シフト動作や取り込まれるデータが異なる場合の出力であり、問題の条件を満たしていません。ウのB1は、クロックとストローブのタイミング関係や取り込みデータのビットパターンが図表で示されている状況と合致しないため不適切です。エのC6も、同様に問題文のシフトレジスタの動作原理やデータ取り込みの法則に照らし合わせると、最終的な確定値として導き出される可能性はありません。
解説は Google Gemini に IPA 公式の問題文・公式解答を入力して生成しています。 事実誤認・選択肢の取り違え・最新法令の反映漏れ等を含む可能性があるため、 重要な判断は必ず IPA 公式資料でご確認ください。
最終更新:
検証プロセス・誤り報告フローは 運営透明性レポートで公開しています。
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