この問題は、1桁の2進数AとBを加算した結果、桁上がり（キャリー）をX、桁上げなしの和（サマ）をYとする論理回路、すなわち半加算器（Half Adder）を問うものです。
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1桁の2進数A,Bを加算し、Xに桁上がり、Yに桁上げなしの和(和の1桁目)が得られる論理回路はどれか。
結論 → 詳細 → 補足 の 3 層構成
この問題は、1桁の2進数AとBを加算した結果、桁上がり（キャリー）をX、桁上げなしの和（サマ）をYとする論理回路、すなわち半加算器（Half Adder）を問うものです。
半加算器の動作は、以下の論理式で定義されます。
和 (Y) = A XOR B （AとBのどちらか一方だけが1の時に1となる）
桁上がり (X) = A AND B （AとBの両方が1の時に1となる）
選択肢アは、A, B, X, Y の4つの入出力があり、これは半加算器の入出力（A, B）と出力（X, Y）に対応します。問題文で示されている「Xに桁上がり、Yに桁上げなしの和」という出力を得る回路として、AとBを入力とし、XとYを出力する論理回路は半加算器であるため、この構成が正解となります。
他の選択肢は、半加算器とは異なる論理構成を示唆していると考えられます。例えば、単に入力AやBを出力とするだけでは加算器の機能は実現できません。また、XORゲートやANDゲート単体では、桁上がりと和の両方を同時に出力する半加算器の機能は果たせません。したがって、これらの選択肢は、問題文の要求を満たさないため不適切です。
解説は Google Gemini に IPA 公式の問題文・公式解答を入力して生成しています。 事実誤認・選択肢の取り違え・最新法令の反映漏れ等を含む可能性があるため、 重要な判断は必ず IPA 公式資料でご確認ください。
最終更新:
検証プロセス・誤り報告フローは 運営透明性レポートで公開しています。
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