ウの入力A:1 B:1 C:0 D:1、出力E:0 F:1 の組合せが、全ての素子が論理積素子（ANDゲート）で構成された左側の回路でのみ成立します。論理積素子は、全ての入力が1のときにのみ出力が1となる論理演算です。
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次の二つの回路の入力に値を与えたとき、表の入力 A, B, C, D と出力 E, F の組合せのうち、全ての素子が論理積素子で構成された左側の回路でだけ成立するものはどれか。
結論 → 詳細 → 補足 の 3 層構成
ウの入力A:1 B:1 C:0 D:1、出力E:0 F:1 の組合せが、全ての素子が論理積素子（ANDゲート）で構成された左側の回路でのみ成立します。論理積素子は、全ての入力が1のときにのみ出力が1となる論理演算です。
アは、全ての入力が0の場合、論理積素子の出力はすべて0となります。左側の回路でEとFが0になるのは正しいですが、右側の回路の挙動が不明なため、左側だけで成立するとは断定できません。
イは、入力A:0 B:0 C:1 D:1 の場合、左側の回路では入力に0が含まれるため、論理積演算の結果、出力Eは0となります。したがって、E:1となるこの選択肢は不適切です。
エは、全ての入力が1の場合、論理積素子の出力はすべて1となります。左側の回路でEとFが1になるのは正しいですが、右側の回路の挙動が不明なため、左側だけで成立するとは断定できません。
解説は Google Gemini に IPA 公式の問題文・公式解答を入力して生成しています。 事実誤認・選択肢の取り違え・最新法令の反映漏れ等を含む可能性があるため、 重要な判断は必ず IPA 公式資料でご確認ください。
最終更新:
検証プロセス・誤り報告フローは 運営透明性レポートで公開しています。
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